预告|思尔芯邀您共聚三月上海EDA/IP沙龙

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2025-03-27

2月28日,2025玄铁 RISC-V 生态大会即将于北京隆重举行。作为国内首家数字EDA供应商,思尔芯受邀参加此次会议,并展示其在 RISC-V生态领域的解决方案、探讨未来发展方向。


时间&地点


2025年3月28日 9:40-10:00

  浦东新区松涛路560号张江大厦21楼会议室


 演讲人&题目

       


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吴滔  思尔芯副总裁
EDA+IP加速数字验证



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您在设计什么类型的芯片?
设计中含的ASIC门容量为?
500万 - 2千万
2千万 - 5千万
5千万 - 1亿
1亿 - 10亿
大于10亿
您倾向于使用哪款FPGA?
赛灵思 VU440
赛灵思 KU115
赛灵思 VU19P
赛灵思 VU13P
赛灵思 VU9P
AMD VP1802
AMD VP1902
英特尔 S10-10M
英特尔 S10-2800
不太确定,需要专业建议
您需要什么样的FPGA配置?
单颗FPGA
双颗FPGA
四颗FPGA
八颗FPGA
不太确定,需要专业建议
您需要什么样的外设接口?
您需要多少数量的原型验证平台?
您是否需要以下原型验证配套工具? (可多选)
分割工具
多FPGA调试工具
协同建模工具(允许大量数据在 FPGA 与 PC 主机之间进行交互)
您什么时间内需要使用到我们产品?
0-6个月
6-12个月
大于12个月
不太确定
您是否需要其他工具资讯?(可多选)
架构设计
软件仿真
硬件仿真
数字调试
形式验证
想要更多了解,您是否需要产品选型指南?
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